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   * [[.:​segger_jlink_edu:​]]   * [[.:​segger_jlink_edu:​]]
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 ===== Glossar ===== ===== Glossar =====
  
-  * ''​TAP'' ​=> ''​Test Access Port''​ => Die Schnittstelle des JTAG verarbeitenden Bauteils. Ein TAP entspricht in der Praxis einem Bauteil (IC).+  * ''​TAP'' ​''​Test Access Port''​ => Die Schnittstelle des JTAG verarbeitenden Bauteils. Ein TAP entspricht in der Praxis einem Bauteil (IC). 
 +  * ''​BSDL''​ => "​Boundary Scan Description Language"​ beschreibt den Chip und seine JTAG-Funktionen 
  
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